5V41068APGG Clock Buffer 450 MHz 2.5V LVDS 1:4 Clock Buffer Circuitos integrados ICs
| IDT | |
| Categoria do produto: | Codificadores, Decodificadores, Multiplexadores e Demultiplexadores |
| RoHS: | Detalhes |
| Multiplexadores | |
| 2 Input | |
| 1 Produção | |
| 3.135 V | |
| 3.465 V | |
| 0 C | |
| + 70 C | |
| SMD/SMT | |
| TSSOP-16 | |
| Tubos | |
| Marca: | IDT |
| Altura: | 1 mm |
| Duração: | 5 mm |
| Tipo de produto: | Codificadores, Decodificadores, Multiplexadores e Demultiplexadores |
| Série: | 5V41068A |
| Subcategoria: | ICs lógicas |
| Largura: | 4.4 mm |
| Parte # Aliases: | IDT5V41068APGG 5V41068A |
| Peso unitário: | 0.006102 onças |
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TÍPO
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Descrição
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Categoria
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Estatuto do produto
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Obsoletos
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DigiKey Programável
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Não verificado
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PLL
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- Não, não.
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Propósito principal
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PCI Express (PCIe)
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Input
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HCSL
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Produção
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HCSL, LVDS
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Número de circuitos
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1
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Relação - Input:Output
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2:1
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Diferencial - Input:Output
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Sim/Sim
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Frequência - Máximo
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200 MHz
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Voltagem - Fornecimento
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3.135V ~ 3.465V
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Temperatura de funcionamento
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0°C ~ 70°C
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Tipo de montagem
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Montagem de superfície
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Embalagem / Caixa
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16-TSSOP (0,173", 4,40 mm de largura)
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Pacote de dispositivos do fornecedor
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16-TSSOP
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Número do produto de base
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Descrição geral
TDescriçãoO IDT5V41068A é um modelo de relógio diferencial 2:1 para aplicações PCIExpress.
O IDT5V41068A selecciona entre os sistemas PCIe Gen2 e Gen3.
1 de 2 HCSLinputs diferenciais para conduzir um único par de saída HCSL diferencial.
para LVDS.
Aplicações recomendadas
• Clock muxing em aplicações PCIe Gen2 e Gen3
ProduçãoCaracterísticas
• Par de saída HCSL diferencial de modo de corrente de 1 ¢ 0,7 V
Características/benefícios
• Baixo jitter aditivo; adequado para utilização em sistemas PCIe Gen2 e Gen3
• Pacote TSSOP de 16 pinos; pequena pegada de placa
• As saídas podem ser encerradas em LVDS; podem conduzir uma maior variedade de dispositivos
• Pin de controlo OE; melhor gestão da energia do sistema
• Disponível numa gama de temperaturas industriais; suporta aplicações embutidas exigentes
• Jitter de ciclo a ciclo aditivo < 5 ps• Jitter de fase aditivo (PCIe Gen3) < 0,2ps
• Frequência de funcionamento até 200 MHz
Informações sobre a aplicação
Capacitores de desacoplagem
Tal como acontece com qualquer circuito integrado de sinal misto de alto desempenho, o IDT5V41068A deve ser isolado da alimentação do sistema
Para um funcionamento óptimo, os condensadores de desacoplamento de 0,01 μF devem ser ligados entre cada
VDD e plano de terra do PCB
